1.1.1.1 AVR 架构局限性突破

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1.1.1.1 AVR 架构局限性突破 1.1.1.1 AVR 架构局限性突破：在 8KB Flash 的铁壁上凿出 DMA 的光——一个基于 Timer1 输出比较匹配中断 + 手动寄存器翻转的伪 DMA UART 接收方案实战手记凌晨两点十七分，我盯着示波器上那串歪斜抖动的 UART 波形，第三次按下复位键。ATmega328P 的 RX 引脚正以 115200bps 吞下上位机发来的 256 字节固件更新包——而它的 USART 接收缓冲区只有 1 字节。没有硬件 FIFO，没有接收完成中断（RXCIE 只在 UDR 有数据时触发，但若主程序未及时读取，下一帧到来即覆盖），更没有 DMA。当第 47 字节被无声吞没、校验失败、整包重传时，我听见自己磨牙的声音。这不是理论推演。