3.2.1 基区宽度调制效应（Early效应）

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3.2.1 基区宽度调制效应（Early效应） 3.2.1 基区宽度调制效应（Early效应）：从物理机制到SPICE建模、版图规避与实测校准的全链路实现指南你有没有在调试一个看似“完美”的共射放大电路时，发现输出电流随$V{CE}$升高而持续爬升——哪怕晶体管早已进入饱和区边缘？你有没有在仿真中反复调整$V{BE}$，却发现小信号增益$gm$和输出电阻$ro$总在“微妙地漂移”，仿佛有个看不见的手在悄悄调节基区厚度？你有没有在流片后测试同一工艺角下的多批次芯片时，观察到$VA$（Early电压）参数标准差高达±18%——而你的带隙基准或电流镜精度要求恰恰卡在这个区间？这不是模型缺陷，也不是测量噪声。